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Convert fmovr to TCG
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commit
dcf2490568
@ -1711,38 +1711,50 @@ static void disas_sparc_insn(DisasContext * dc)
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xop = GET_FIELD(insn, 18, 26);
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#ifdef TARGET_SPARC64
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if ((xop & 0x11f) == 0x005) { // V9 fmovsr
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TCGv r_zero;
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int l1;
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||||
l1 = gen_new_label();
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||||
r_zero = tcg_temp_new(TCG_TYPE_TL);
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||||
cond = GET_FIELD_SP(insn, 14, 17);
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||||
gen_op_load_fpr_FT0(rd);
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||||
gen_op_load_fpr_FT1(rs2);
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||||
rs1 = GET_FIELD(insn, 13, 17);
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||||
gen_movl_reg_T0(rs1);
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||||
flush_T2(dc);
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gen_cond_reg(cond);
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||||
gen_op_fmovs_cc();
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||||
tcg_gen_movi_tl(r_zero, 0);
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||||
tcg_gen_brcond_tl(gen_tcg_cond_reg[cond], cpu_T[0], r_zero, l1);
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||||
gen_op_load_fpr_FT1(rs2);
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||||
gen_op_store_FT0_fpr(rd);
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||||
gen_set_label(l1);
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break;
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} else if ((xop & 0x11f) == 0x006) { // V9 fmovdr
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||||
TCGv r_zero;
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||||
int l1;
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||||
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||||
l1 = gen_new_label();
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||||
r_zero = tcg_temp_new(TCG_TYPE_TL);
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||||
cond = GET_FIELD_SP(insn, 14, 17);
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||||
gen_op_load_fpr_DT0(DFPREG(rd));
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||||
gen_op_load_fpr_DT1(DFPREG(rs2));
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||||
flush_T2(dc);
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||||
rs1 = GET_FIELD(insn, 13, 17);
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||||
gen_movl_reg_T0(rs1);
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||||
gen_cond_reg(cond);
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||||
gen_op_fmovs_cc();
|
||||
tcg_gen_movi_tl(r_zero, 0);
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||||
tcg_gen_brcond_tl(gen_tcg_cond_reg[cond], cpu_T[0], r_zero, l1);
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||||
gen_op_load_fpr_DT1(DFPREG(rs2));
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||||
gen_op_store_DT0_fpr(DFPREG(rd));
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||||
gen_set_label(l1);
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||||
break;
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} else if ((xop & 0x11f) == 0x007) { // V9 fmovqr
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#if defined(CONFIG_USER_ONLY)
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TCGv r_zero;
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int l1;
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||||
l1 = gen_new_label();
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||||
r_zero = tcg_temp_new(TCG_TYPE_TL);
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||||
cond = GET_FIELD_SP(insn, 14, 17);
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||||
gen_op_load_fpr_QT0(QFPREG(rd));
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||||
gen_op_load_fpr_QT1(QFPREG(rs2));
|
||||
flush_T2(dc);
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||||
rs1 = GET_FIELD(insn, 13, 17);
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||||
gen_movl_reg_T0(rs1);
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||||
gen_cond_reg(cond);
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||||
gen_op_fmovq_cc();
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||||
tcg_gen_movi_tl(r_zero, 0);
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||||
tcg_gen_brcond_tl(gen_tcg_cond_reg[cond], cpu_T[0], r_zero, l1);
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||||
gen_op_load_fpr_QT1(QFPREG(rs2));
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||||
gen_op_store_QT0_fpr(QFPREG(rd));
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||||
gen_set_label(l1);
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||||
break;
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#else
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goto nfpu_insn;
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