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target/microblaze: Convert dec_pattern to decodetree
Tested-by: Edgar E. Iglesias <edgar.iglesias@xilinx.com> Reviewed-by: Edgar E. Iglesias <edgar.iglesias@xilinx.com> Signed-off-by: Richard Henderson <richard.henderson@linaro.org>
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commit
607f576762
@ -44,6 +44,10 @@ addikc 001110 ..... ..... ................ @typeb
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cmp 000101 ..... ..... ..... 000 0000 0001 @typea
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cmpu 000101 ..... ..... ..... 000 0000 0011 @typea
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||||
pcmpbf 100000 ..... ..... ..... 100 0000 0000 @typea
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pcmpeq 100010 ..... ..... ..... 100 0000 0000 @typea
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pcmpne 100011 ..... ..... ..... 100 0000 0000 @typea
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||||
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rsub 000001 ..... ..... ..... 000 0000 0000 @typea
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rsubc 000011 ..... ..... ..... 000 0000 0000 @typea
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||||
rsubk 000101 ..... ..... ..... 000 0000 0000 @typea
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@ -279,6 +279,10 @@ static bool do_typeb_val(DisasContext *dc, arg_typeb *arg, bool side_effects,
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static bool trans_##NAME(DisasContext *dc, arg_typea *a) \
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{ return do_typea(dc, a, SE, FN); }
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#define DO_TYPEA_CFG(NAME, CFG, SE, FN) \
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||||
static bool trans_##NAME(DisasContext *dc, arg_typea *a) \
|
||||
{ return dc->cpu->cfg.CFG && do_typea(dc, a, SE, FN); }
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||||
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||||
#define DO_TYPEBI(NAME, SE, FNI) \
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||||
static bool trans_##NAME(DisasContext *dc, arg_typeb *a) \
|
||||
{ return do_typeb_imm(dc, a, SE, FNI); }
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||||
@ -350,6 +354,20 @@ static void gen_cmpu(TCGv_i32 out, TCGv_i32 ina, TCGv_i32 inb)
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DO_TYPEA(cmp, false, gen_cmp)
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||||
DO_TYPEA(cmpu, false, gen_cmpu)
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static void gen_pcmpeq(TCGv_i32 out, TCGv_i32 ina, TCGv_i32 inb)
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||||
{
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||||
tcg_gen_setcond_i32(TCG_COND_EQ, out, ina, inb);
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||||
}
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||||
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||||
static void gen_pcmpne(TCGv_i32 out, TCGv_i32 ina, TCGv_i32 inb)
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||||
{
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||||
tcg_gen_setcond_i32(TCG_COND_NE, out, ina, inb);
|
||||
}
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||||
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||||
DO_TYPEA_CFG(pcmpbf, use_pcmp_instr, false, gen_helper_pcmpbf)
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||||
DO_TYPEA_CFG(pcmpeq, use_pcmp_instr, false, gen_pcmpeq)
|
||||
DO_TYPEA_CFG(pcmpne, use_pcmp_instr, false, gen_pcmpne)
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||||
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||||
/* No input carry, but output carry. */
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||||
static void gen_rsub(TCGv_i32 out, TCGv_i32 ina, TCGv_i32 inb)
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||||
{
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||||
@ -413,49 +431,10 @@ static bool trans_zero(DisasContext *dc, arg_zero *arg)
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||||
return false;
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}
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||||
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||||
static void dec_pattern(DisasContext *dc)
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||||
{
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||||
unsigned int mode;
|
||||
|
||||
if (trap_illegal(dc, !dc->cpu->cfg.use_pcmp_instr)) {
|
||||
return;
|
||||
}
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||||
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||||
mode = dc->opcode & 3;
|
||||
switch (mode) {
|
||||
case 0:
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||||
/* pcmpbf. */
|
||||
if (dc->rd)
|
||||
gen_helper_pcmpbf(cpu_R[dc->rd], cpu_R[dc->ra], cpu_R[dc->rb]);
|
||||
break;
|
||||
case 2:
|
||||
if (dc->rd) {
|
||||
tcg_gen_setcond_i32(TCG_COND_EQ, cpu_R[dc->rd],
|
||||
cpu_R[dc->ra], cpu_R[dc->rb]);
|
||||
}
|
||||
break;
|
||||
case 3:
|
||||
if (dc->rd) {
|
||||
tcg_gen_setcond_i32(TCG_COND_NE, cpu_R[dc->rd],
|
||||
cpu_R[dc->ra], cpu_R[dc->rb]);
|
||||
}
|
||||
break;
|
||||
default:
|
||||
cpu_abort(CPU(dc->cpu),
|
||||
"unsupported pattern insn opcode=%x\n", dc->opcode);
|
||||
break;
|
||||
}
|
||||
}
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||||
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||||
static void dec_and(DisasContext *dc)
|
||||
{
|
||||
unsigned int not;
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||||
|
||||
if (!dc->type_b && (dc->imm & (1 << 10))) {
|
||||
dec_pattern(dc);
|
||||
return;
|
||||
}
|
||||
|
||||
not = dc->opcode & (1 << 1);
|
||||
|
||||
if (!dc->rd)
|
||||
@ -469,22 +448,12 @@ static void dec_and(DisasContext *dc)
|
||||
|
||||
static void dec_or(DisasContext *dc)
|
||||
{
|
||||
if (!dc->type_b && (dc->imm & (1 << 10))) {
|
||||
dec_pattern(dc);
|
||||
return;
|
||||
}
|
||||
|
||||
if (dc->rd)
|
||||
tcg_gen_or_i32(cpu_R[dc->rd], cpu_R[dc->ra], *(dec_alu_op_b(dc)));
|
||||
}
|
||||
|
||||
static void dec_xor(DisasContext *dc)
|
||||
{
|
||||
if (!dc->type_b && (dc->imm & (1 << 10))) {
|
||||
dec_pattern(dc);
|
||||
return;
|
||||
}
|
||||
|
||||
if (dc->rd)
|
||||
tcg_gen_xor_i32(cpu_R[dc->rd], cpu_R[dc->ra], *(dec_alu_op_b(dc)));
|
||||
}
|
||||
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