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https://mirrors.bfsu.edu.cn/git/linux.git
synced 2024-12-21 01:54:51 +08:00
drm/bridge: extract some Analogix I2C DP common code
Some code can be shared within different DP bridges by Analogix. Extract them to analogix_dp. Signed-off-by: Icenowy Zheng <icenowy@aosc.io> Signed-off-by: Vasily Khoruzhick <anarsoul@gmail.com> Signed-off-by: Torsten Duwe <duwe@suse.de> Reviewed-by: Andrzej Hajda <a.hajda@samsung.com> Signed-off-by: Maxime Ripard <maxime@cerno.tech> Link: https://patchwork.freedesktop.org/patch/msgid/20191107135214.966BD68BFE@verein.lst.de
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ad9301a2a3
commit
0712eca92c
@ -1,4 +1,4 @@
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# SPDX-License-Identifier: GPL-2.0-only
|
# SPDX-License-Identifier: GPL-2.0-only
|
||||||
analogix_dp-objs := analogix_dp_core.o analogix_dp_reg.o
|
analogix_dp-objs := analogix_dp_core.o analogix_dp_reg.o analogix-i2c-dptx.o
|
||||||
obj-$(CONFIG_DRM_ANALOGIX_ANX78XX) += analogix-anx78xx.o
|
obj-$(CONFIG_DRM_ANALOGIX_ANX78XX) += analogix-anx78xx.o
|
||||||
obj-$(CONFIG_DRM_ANALOGIX_DP) += analogix_dp.o
|
obj-$(CONFIG_DRM_ANALOGIX_DP) += analogix_dp.o
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||||||
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@ -36,8 +36,6 @@
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#define I2C_IDX_RX_P1 4
|
#define I2C_IDX_RX_P1 4
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#define XTAL_CLK 270 /* 27M */
|
#define XTAL_CLK 270 /* 27M */
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#define AUX_CH_BUFFER_SIZE 16
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||||||
#define AUX_WAIT_TIMEOUT_MS 15
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static const u8 anx7808_i2c_addresses[] = {
|
static const u8 anx7808_i2c_addresses[] = {
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||||||
[I2C_IDX_TX_P0] = 0x78,
|
[I2C_IDX_TX_P0] = 0x78,
|
||||||
@ -107,153 +105,11 @@ static int anx78xx_clear_bits(struct regmap *map, u8 reg, u8 mask)
|
|||||||
return regmap_update_bits(map, reg, mask, 0);
|
return regmap_update_bits(map, reg, mask, 0);
|
||||||
}
|
}
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||||||
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||||||
static bool anx78xx_aux_op_finished(struct anx78xx *anx78xx)
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{
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unsigned int value;
|
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||||||
int err;
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||||||
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err = regmap_read(anx78xx->map[I2C_IDX_TX_P0], SP_DP_AUX_CH_CTRL2_REG,
|
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||||||
&value);
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||||||
if (err < 0)
|
|
||||||
return false;
|
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||||||
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||||||
return (value & SP_AUX_EN) == 0;
|
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||||||
}
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||||||
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static int anx78xx_aux_wait(struct anx78xx *anx78xx)
|
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{
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unsigned long timeout;
|
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unsigned int status;
|
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||||||
int err;
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||||||
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||||||
timeout = jiffies + msecs_to_jiffies(AUX_WAIT_TIMEOUT_MS) + 1;
|
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||||||
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||||||
while (!anx78xx_aux_op_finished(anx78xx)) {
|
|
||||||
if (time_after(jiffies, timeout)) {
|
|
||||||
if (!anx78xx_aux_op_finished(anx78xx)) {
|
|
||||||
DRM_ERROR("Timed out waiting AUX to finish\n");
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||||||
return -ETIMEDOUT;
|
|
||||||
}
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||||||
|
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||||||
break;
|
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||||||
}
|
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||||||
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usleep_range(1000, 2000);
|
|
||||||
}
|
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||||||
|
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||||||
/* Read the AUX channel access status */
|
|
||||||
err = regmap_read(anx78xx->map[I2C_IDX_TX_P0], SP_AUX_CH_STATUS_REG,
|
|
||||||
&status);
|
|
||||||
if (err < 0) {
|
|
||||||
DRM_ERROR("Failed to read from AUX channel: %d\n", err);
|
|
||||||
return err;
|
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||||||
}
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||||||
|
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||||||
if (status & SP_AUX_STATUS) {
|
|
||||||
DRM_ERROR("Failed to wait for AUX channel (status: %02x)\n",
|
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status);
|
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||||||
return -ETIMEDOUT;
|
|
||||||
}
|
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||||||
|
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||||||
return 0;
|
|
||||||
}
|
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static int anx78xx_aux_address(struct anx78xx *anx78xx, unsigned int addr)
|
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||||||
{
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int err;
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||||||
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||||||
err = regmap_write(anx78xx->map[I2C_IDX_TX_P0], SP_AUX_ADDR_7_0_REG,
|
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||||||
addr & 0xff);
|
|
||||||
if (err)
|
|
||||||
return err;
|
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||||||
|
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||||||
err = regmap_write(anx78xx->map[I2C_IDX_TX_P0], SP_AUX_ADDR_15_8_REG,
|
|
||||||
(addr & 0xff00) >> 8);
|
|
||||||
if (err)
|
|
||||||
return err;
|
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||||||
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/*
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||||||
* DP AUX CH Address Register #2, only update bits[3:0]
|
|
||||||
* [7:4] RESERVED
|
|
||||||
* [3:0] AUX_ADDR[19:16], Register control AUX CH address.
|
|
||||||
*/
|
|
||||||
err = regmap_update_bits(anx78xx->map[I2C_IDX_TX_P0],
|
|
||||||
SP_AUX_ADDR_19_16_REG,
|
|
||||||
SP_AUX_ADDR_19_16_MASK,
|
|
||||||
(addr & 0xf0000) >> 16);
|
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||||||
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
|
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||||||
return 0;
|
|
||||||
}
|
|
||||||
|
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||||||
static ssize_t anx78xx_aux_transfer(struct drm_dp_aux *aux,
|
static ssize_t anx78xx_aux_transfer(struct drm_dp_aux *aux,
|
||||||
struct drm_dp_aux_msg *msg)
|
struct drm_dp_aux_msg *msg)
|
||||||
{
|
{
|
||||||
struct anx78xx *anx78xx = container_of(aux, struct anx78xx, aux);
|
struct anx78xx *anx78xx = container_of(aux, struct anx78xx, aux);
|
||||||
u8 ctrl1 = msg->request;
|
return anx_dp_aux_transfer(anx78xx->map[I2C_IDX_TX_P0], msg);
|
||||||
u8 ctrl2 = SP_AUX_EN;
|
|
||||||
u8 *buffer = msg->buffer;
|
|
||||||
int err;
|
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||||||
|
|
||||||
/* The DP AUX transmit and receive buffer has 16 bytes. */
|
|
||||||
if (WARN_ON(msg->size > AUX_CH_BUFFER_SIZE))
|
|
||||||
return -E2BIG;
|
|
||||||
|
|
||||||
/* Zero-sized messages specify address-only transactions. */
|
|
||||||
if (msg->size < 1)
|
|
||||||
ctrl2 |= SP_ADDR_ONLY;
|
|
||||||
else /* For non-zero-sized set the length field. */
|
|
||||||
ctrl1 |= (msg->size - 1) << SP_AUX_LENGTH_SHIFT;
|
|
||||||
|
|
||||||
if ((msg->request & DP_AUX_I2C_READ) == 0) {
|
|
||||||
/* When WRITE | MOT write values to data buffer */
|
|
||||||
err = regmap_bulk_write(anx78xx->map[I2C_IDX_TX_P0],
|
|
||||||
SP_DP_BUF_DATA0_REG, buffer,
|
|
||||||
msg->size);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
}
|
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||||||
|
|
||||||
/* Write address and request */
|
|
||||||
err = anx78xx_aux_address(anx78xx, msg->address);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
|
|
||||||
err = regmap_write(anx78xx->map[I2C_IDX_TX_P0], SP_DP_AUX_CH_CTRL1_REG,
|
|
||||||
ctrl1);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
|
|
||||||
/* Start transaction */
|
|
||||||
err = regmap_update_bits(anx78xx->map[I2C_IDX_TX_P0],
|
|
||||||
SP_DP_AUX_CH_CTRL2_REG, SP_ADDR_ONLY |
|
|
||||||
SP_AUX_EN, ctrl2);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
|
|
||||||
err = anx78xx_aux_wait(anx78xx);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
|
|
||||||
msg->reply = DP_AUX_I2C_REPLY_ACK;
|
|
||||||
|
|
||||||
if ((msg->size > 0) && (msg->request & DP_AUX_I2C_READ)) {
|
|
||||||
/* Read values from data buffer */
|
|
||||||
err = regmap_bulk_read(anx78xx->map[I2C_IDX_TX_P0],
|
|
||||||
SP_DP_BUF_DATA0_REG, buffer,
|
|
||||||
msg->size);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
}
|
|
||||||
|
|
||||||
err = anx78xx_clear_bits(anx78xx->map[I2C_IDX_TX_P0],
|
|
||||||
SP_DP_AUX_CH_CTRL2_REG, SP_ADDR_ONLY);
|
|
||||||
if (err)
|
|
||||||
return err;
|
|
||||||
|
|
||||||
return msg->size;
|
|
||||||
}
|
}
|
||||||
|
|
||||||
static int anx78xx_set_hpd(struct anx78xx *anx78xx)
|
static int anx78xx_set_hpd(struct anx78xx *anx78xx)
|
||||||
|
165
drivers/gpu/drm/bridge/analogix/analogix-i2c-dptx.c
Normal file
165
drivers/gpu/drm/bridge/analogix/analogix-i2c-dptx.c
Normal file
@ -0,0 +1,165 @@
|
|||||||
|
/* SPDX-License-Identifier: GPL-2.0-only */
|
||||||
|
/*
|
||||||
|
* Copyright(c) 2016, Analogix Semiconductor.
|
||||||
|
*
|
||||||
|
* Based on anx7808 driver obtained from chromeos with copyright:
|
||||||
|
* Copyright(c) 2013, Google Inc.
|
||||||
|
*/
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|
#include <linux/regmap.h>
|
||||||
|
|
||||||
|
#include <drm/drm.h>
|
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|
#include <drm/drm_dp_helper.h>
|
||||||
|
#include <drm/drm_print.h>
|
||||||
|
|
||||||
|
#include "analogix-i2c-dptx.h"
|
||||||
|
|
||||||
|
#define AUX_WAIT_TIMEOUT_MS 15
|
||||||
|
#define AUX_CH_BUFFER_SIZE 16
|
||||||
|
|
||||||
|
static int anx_i2c_dp_clear_bits(struct regmap *map, u8 reg, u8 mask)
|
||||||
|
{
|
||||||
|
return regmap_update_bits(map, reg, mask, 0);
|
||||||
|
}
|
||||||
|
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||||||
|
static bool anx_dp_aux_op_finished(struct regmap *map_dptx)
|
||||||
|
{
|
||||||
|
unsigned int value;
|
||||||
|
int err;
|
||||||
|
|
||||||
|
err = regmap_read(map_dptx, SP_DP_AUX_CH_CTRL2_REG, &value);
|
||||||
|
if (err < 0)
|
||||||
|
return false;
|
||||||
|
|
||||||
|
return (value & SP_AUX_EN) == 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int anx_dp_aux_wait(struct regmap *map_dptx)
|
||||||
|
{
|
||||||
|
unsigned long timeout;
|
||||||
|
unsigned int status;
|
||||||
|
int err;
|
||||||
|
|
||||||
|
timeout = jiffies + msecs_to_jiffies(AUX_WAIT_TIMEOUT_MS) + 1;
|
||||||
|
|
||||||
|
while (!anx_dp_aux_op_finished(map_dptx)) {
|
||||||
|
if (time_after(jiffies, timeout)) {
|
||||||
|
if (!anx_dp_aux_op_finished(map_dptx)) {
|
||||||
|
DRM_ERROR("Timed out waiting AUX to finish\n");
|
||||||
|
return -ETIMEDOUT;
|
||||||
|
}
|
||||||
|
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
usleep_range(1000, 2000);
|
||||||
|
}
|
||||||
|
|
||||||
|
/* Read the AUX channel access status */
|
||||||
|
err = regmap_read(map_dptx, SP_AUX_CH_STATUS_REG, &status);
|
||||||
|
if (err < 0) {
|
||||||
|
DRM_ERROR("Failed to read from AUX channel: %d\n", err);
|
||||||
|
return err;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (status & SP_AUX_STATUS) {
|
||||||
|
DRM_ERROR("Failed to wait for AUX channel (status: %02x)\n",
|
||||||
|
status);
|
||||||
|
return -ETIMEDOUT;
|
||||||
|
}
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int anx_dp_aux_address(struct regmap *map_dptx, unsigned int addr)
|
||||||
|
{
|
||||||
|
int err;
|
||||||
|
|
||||||
|
err = regmap_write(map_dptx, SP_AUX_ADDR_7_0_REG, addr & 0xff);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
err = regmap_write(map_dptx, SP_AUX_ADDR_15_8_REG,
|
||||||
|
(addr & 0xff00) >> 8);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
/*
|
||||||
|
* DP AUX CH Address Register #2, only update bits[3:0]
|
||||||
|
* [7:4] RESERVED
|
||||||
|
* [3:0] AUX_ADDR[19:16], Register control AUX CH address.
|
||||||
|
*/
|
||||||
|
err = regmap_update_bits(map_dptx, SP_AUX_ADDR_19_16_REG,
|
||||||
|
SP_AUX_ADDR_19_16_MASK,
|
||||||
|
(addr & 0xf0000) >> 16);
|
||||||
|
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
ssize_t anx_dp_aux_transfer(struct regmap *map_dptx,
|
||||||
|
struct drm_dp_aux_msg *msg)
|
||||||
|
{
|
||||||
|
u8 ctrl1 = msg->request;
|
||||||
|
u8 ctrl2 = SP_AUX_EN;
|
||||||
|
u8 *buffer = msg->buffer;
|
||||||
|
int err;
|
||||||
|
|
||||||
|
/* The DP AUX transmit and receive buffer has 16 bytes. */
|
||||||
|
if (WARN_ON(msg->size > AUX_CH_BUFFER_SIZE))
|
||||||
|
return -E2BIG;
|
||||||
|
|
||||||
|
/* Zero-sized messages specify address-only transactions. */
|
||||||
|
if (msg->size < 1)
|
||||||
|
ctrl2 |= SP_ADDR_ONLY;
|
||||||
|
else /* For non-zero-sized set the length field. */
|
||||||
|
ctrl1 |= (msg->size - 1) << SP_AUX_LENGTH_SHIFT;
|
||||||
|
|
||||||
|
if ((msg->request & DP_AUX_I2C_READ) == 0) {
|
||||||
|
/* When WRITE | MOT write values to data buffer */
|
||||||
|
err = regmap_bulk_write(map_dptx,
|
||||||
|
SP_DP_BUF_DATA0_REG, buffer,
|
||||||
|
msg->size);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
}
|
||||||
|
|
||||||
|
/* Write address and request */
|
||||||
|
err = anx_dp_aux_address(map_dptx, msg->address);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
err = regmap_write(map_dptx, SP_DP_AUX_CH_CTRL1_REG, ctrl1);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
/* Start transaction */
|
||||||
|
err = regmap_update_bits(map_dptx, SP_DP_AUX_CH_CTRL2_REG,
|
||||||
|
SP_ADDR_ONLY | SP_AUX_EN, ctrl2);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
err = anx_dp_aux_wait(map_dptx);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
msg->reply = DP_AUX_I2C_REPLY_ACK;
|
||||||
|
|
||||||
|
if ((msg->size > 0) && (msg->request & DP_AUX_I2C_READ)) {
|
||||||
|
/* Read values from data buffer */
|
||||||
|
err = regmap_bulk_read(map_dptx,
|
||||||
|
SP_DP_BUF_DATA0_REG, buffer,
|
||||||
|
msg->size);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
}
|
||||||
|
|
||||||
|
err = anx_i2c_dp_clear_bits(map_dptx, SP_DP_AUX_CH_CTRL2_REG,
|
||||||
|
SP_ADDR_ONLY);
|
||||||
|
if (err)
|
||||||
|
return err;
|
||||||
|
|
||||||
|
return msg->size;
|
||||||
|
}
|
||||||
|
EXPORT_SYMBOL_GPL(anx_dp_aux_transfer);
|
@ -242,4 +242,7 @@
|
|||||||
/* DP AUX Buffer Data Registers */
|
/* DP AUX Buffer Data Registers */
|
||||||
#define SP_DP_BUF_DATA0_REG 0xf0
|
#define SP_DP_BUF_DATA0_REG 0xf0
|
||||||
|
|
||||||
|
ssize_t anx_dp_aux_transfer(struct regmap *map_dptx,
|
||||||
|
struct drm_dp_aux_msg *msg);
|
||||||
|
|
||||||
#endif
|
#endif
|
||||||
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